SIMULADOR DE UCP COM SUPORTE À MEMÓRIA CACHE E PIPELINE

Um problema comum em disciplinas de arquitetura de computadores é a dinâmica real dos processos que ocorrem internamente em hardware. O funcionamento de uma UCP, por exemplo, é algo complexo e sua compreensão é fundamental para utilização de seus recursos. Este trabalho contribui com o desenvolvimen...

Full description

Bibliographic Details
Main Authors: Artur Jordão Lima Correia, Mario Augusto Pazoti, Francisco Assis da Silva, Leandro Luiz de Almeida, Danillo Roberto Pereira
Format: Article
Language:Portuguese
Published: Universidade do Oeste Paulista 2015-01-01
Series:Colloquium Exactarum
Subjects:
Online Access:http://revistas.unoeste.br/index.php/ce/article/view/1096
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issn 2178-8332
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description Um problema comum em disciplinas de arquitetura de computadores é a dinâmica real dos processos que ocorrem internamente em hardware. O funcionamento de uma UCP, por exemplo, é algo complexo e sua compreensão é fundamental para utilização de seus recursos. Este trabalho contribui com o desenvolvimento de um simulador de UCP com suporte à memória cache e pipeline. São apresentados os resultados obtidos com a ferramenta desenvolvida, e que a utilização do simulador pode ser muito útil como apoio em disciplinas de arquitetura de computadores, melhorando o entendimento por parte dos alunos.
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